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寄存器时钟

网络释义

  SRCLK

不管是移位寄存器时钟SRCLK)还是存储寄存器时钟(RCLK),都是上升沿触发。如果当两个时钟绑定在一起时,则移位寄存器将一直领先存储寄存器一个时钟脉冲。

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短语

寄存器时钟脉冲 register clock pulse ; RCP

移位寄存器时钟 SRCK

移位寄存器的时钟 SRCK

有道翻译

寄存器时钟

Register clock

以上为机器翻译结果,长、整句建议使用 人工翻译

双语例句

  • 按照逻辑芯片设计特点芯片工作信号分为4时钟信号、输入信号、组合输出信号寄存器输出信号。

    According to the logic chip design feature, the chip work's time signal can be divided into 4 kinds: clock signal, input signal, combination output signal and register output signal.

    youdao

  • 就是移位寄存器因为数据时钟脉冲作用下通过寄存器移动一位。

    It is called a shift register because the data is shifted through the register by one bit position on each clock pulse.

    youdao

  • 通信协议中主要实现双向数据缓冲器数据移位寄存器时钟控制电路以及奇偶校验功能

    The protocol realized some functions, such as two-way data buffer, shift register, clock circuit and parity check.

    youdao

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- 来自原声例句
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