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clock gating

  • 时钟门控：一种在同步时序逻辑电路中使用的定时器信号技术，旨在降低芯片功耗。

网络释义专业释义英英释义

短语

Clock-gating checks 时钟门锁检查 ; 时钟门的检查

clock gating circuit 门控时钟

power and clock gating 功率和时钟门控

clock-gating 门控时钟

fine grain Aggressive Clock Gating 技术包括精细度渐进时钟门控

Programmable clock Gating 可编程门控时钟技术

clock gating technique 门控技术

clock-gating technique 门控技术

Cell level Clock Gating 单元级门控时钟技术

Gating the Clock 选通时钟

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  • 门控时钟 - 引用次数：23

    The clock gating technique is merely applicable to single edge-triggered flip-flop. It is a special kind of clock edge control technique.

    而门控时钟技术只适用于单边沿触发器,是一种特殊的时钟边沿控制技术。

    参考来源 - 时钟边沿控制技术及低功耗触发器研究
  • 门控时钟 - 引用次数：6

    Based on this, the clock management unit is introduced and the clock gating technique is employeed for the low power design of the processor core.

    在此基础上,本文引入了时钟管理单元并采用门控时钟技术降低功耗。

    参考来源 - 一种16位数字信号处理器内核的研究与设计
    时钟门控 - 引用次数：2

    Under the guide of the OSH-ASIP design method, a CI-dedicated low-power DSP is designed and implemented in 0.18μm CMOS process, with various low-power techniques including instruction-set reduction, wait mode, loop cache, memory partitioning, operand isolation and clock gating.

    最后,在OSH-ASIP设计方法的指导下,综合运用指令集简化、等待模式、循环暂存、存储器切割、操作数隔离和时钟门控等多种低功耗设计技术,在0.18μm CMOS工艺下设计并实现了一款人工耳蜗专用的低功耗DSP。

    参考来源 - 一种双模人工耳蜗系统及其低功耗数字信号处理器的设计

·2,447,543篇论文数据，部分数据来源于NoteExpress

Clock gating

  • abstract: Clock gating is a popular technique used in many synchronous circuits for reducing dynamic power dissipation. Clock gating saves power by adding more logic to a circuit to prune the clock tree.

以上来源于: WordNet

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- 来自原声例句
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