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system level synthesis

网络释义专业释义

短语

System-Level Synthesis 系统级综合

vhdl high level synthesis system vhdl语言高级综合系统

  • 系统级综合 - 引用次数:3

    Multi-objective genetic algorithms are effective in solving SoC system level synthesis. These available algorithms can only attain part of the whole Pareto front,because of the worse local searching ability,the convergence speed is slow.

    多目标遗传算法是解决SoC系统级综合问题的有效途径之一,但现有的遗传算法只能求得非劣解集前沿的一部分,局部搜索能力差,收敛速度较慢。

    参考来源 - 自适应小生境遗传算法在系统级综合中的应用 in C
    系统等级合成

·2,447,543篇论文数据,部分数据来源于NoteExpress

双语例句

  • Each level of decomposition forces design decisions, providing ongoing synthesis, coupling of requirements and design specifications, and increasing system detail.

    每个分解级别强制进行设计决策提供正在进行合成连接需求设计规格说明增加系统详细内容

    youdao

  • Because the behaviors of digital system can be described by register transfer level (RTL) behavior exactly, RTL synthesis becomes the mainstream design method in EDA domain.

    由于寄存器传输(rtl)行为描述可以精确地确定数字系统操作,所以寄存器传输级综合成为当前EDA行业主流设计方法

    youdao

  • As the behavior of digital system can be fully described by the register transfer level (RTL) behavior descriptor, so RTL synthesis has become the mainstream design method in EDA domain.

    寄存器传输(rtl)综合实现从rtl行为描述到门级结构描述的转换,是目前EDA设计行业主流设计方法

    youdao

更多双语例句
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- 来自原声例句
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