然而一般的移动估测单元积体电路设计，仅设计运算 单元阵列 ( PE Array )部分而未考虑位址产生单元( Address Generation Unit, AGU )与搜寻区域记忆体( Search Area RAM )，故不够完整且在实现运算单元...
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处理单元阵列
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pe array shift pe阵列平移
PE-array shift 阵列平移
parallel PE array 并行处理单元阵列
pe array
pe数组
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The timing requirements for PE structure and the adder array for adder tree structure to optimize performance of design are studied and used.
研究了并利用PE(处理单元)结构时序约束和加法树结构的加法阵列优化设计性能。
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