... edge trigger ==> 边缘触发 edge trigger flip flop ==> 边缘触发触发器 edge triggered flip-flop ==> 边沿触发的触发器 ...
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edge trigger flip flop
边缘触发触发器
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To erase redundancy of the clock, improve clock utilization rate and reduce power dissipation, this paper proposes the logic design of low power flip-flop based on double edge trigger.
从消除时钟冗余，提高时钟利用率以达到降低功耗的思想出发，提出基于双边沿触发的触发器的逻辑设计。
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