...而该第一NMOS 电晶体被关闭， 所以第一输出端会充电至逻辑高电位，又此时该反相时脉为该第二电源电 压之逻辑高电位（Logic high），该第二NMOS 电晶体被导通而该第二PMOS 电晶体被关闭，所以第二输出端会放电至逻辑低电位。
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逻辑高电位
Logical high potential
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