逻辑译码单元(LOG UNIT)入口,从而实现微程序的顺序,分支,循环运行,及三个工作寄存器R0,R1,R2GAL构成.
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逻辑译码单元
Logical decoding unit
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他由一个8位6502 CPU（不支持整数模式，也被称为BCD），DMA传输单元，伪音频处理单元，1/12时钟分频器，以及1位逻辑单位的地址译码。
It consists of an 8-bit 6502 CPU (without support for decimal mode, also known as BCD), DMA transfer unit, pseudo audio processing unit, 1/12 clock divider, and a bit of logic for address decoding.
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