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系统主时钟

网络释义

  MCLK

MCLK系统主时钟):可由软件选择来自LFXT1CLK、XT2CLK、DCOCLK三者之一,然后经1,2,4,8分频后得到。分频系数可选,由参数DIVM控制。

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短语

主系统时钟 MCLK ; Main System Clock

外部主系统时钟输入 EXCLK

有道翻译

系统主时钟

System master clock

以上为机器翻译结果,长、整句建议使用 人工翻译

双语例句

  • 系统芯片采用EP1K100 QC 208 - 3,时钟模块控制模块、计时模块、数据译码模块、显示以及报时模块组成。

    The main system chips used EP1K100QC208-3, make up of the clock module, control module, time module, data decoding module, display and broadcast module.

    youdao

  • 理论实例分析表明,通信系统—从时钟方式电流差动保护装置复用数字通信系统时正确工作理想方式。

    It is shown by theory and case study that the master - slave clock mode in a com munication system is ideal for proper functions of the current differential protection.

    youdao

  • 首先针对网络控制系统分布式特点,特别是类似于CAN总线的多系统由于没有单一的时钟提供同步机制,影响调度管理同步。

    First, aiming at the distribution of NCS, specially the multi-master system such as CAN, there is no unified network clock, so the scheduling and management are affected.

    youdao

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- 来自原声例句
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