采用 FPGA(现场可编程门阵列)的验证后的 RTL(电阻晶体管逻辑)设计数据即可实现与 FPGA的兼容性，并缩短了样品交付所需的周期时间，最低只需5周，这是传统ASIC(专用集成电路)的1/5。
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电阻晶体管逻辑电路 RTL ; resistor transistor logic circuit
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电阻-电容晶体管逻辑 resistance capacitance transistor logic
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