MAX9205或MAX9207LVDS串行器发送LVDS信号,电缆故障测试仪串行器在并行数据时钟(TCLK)的上升沿锁存10位并行数据,加入2位同步码后通过单路LVDS输出端口发送串行数据。
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并行数据时钟(PDCLK)用于将I/Q数据输入同步至 AD9957。
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并行数据时钟
Parallel data clock
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与传统并行数据恢复电路相比,该电路不需要本地参考时钟,并且恢复出的并行数据是位同步的。
Compared with conventional circuits, the recovered parallel data is bit-synchronous, and the reference clock is avoided.
youdao
在串并转换接收器中,并行数据在字节时钟的作用下并行输出。
In the deserializer, parallel data are clocked out by byte clock.
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