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全局时钟输入引脚

网络释义

  GCLK

Spartan-6 FPGA的时钟资源主要由四种类型的连接器构成: 全局时钟输入引脚GCLK) 全局时钟多路复用器(BUFG、BUFGMUX) IO时钟缓冲器(BUFIO2、BUFIO2_2CLK、BUFPLL) 水平方向时钟布线缓冲器(BUFH) 有两种类...

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有道翻译

全局时钟输入引脚

Global clock input pin

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