这种数字滤波器通常使用 dsPIC DSC 架构中的乘法累加（Multiply-Accumulate， MAC）类DSP 指令用软件实现。MAC 类指令要求输入 数据表示为 1.15 有符号小数格式。
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文章提出的新型乘法累加器，具有在不同模式下分别处理16位与32位数据，或16位与32位数据混合运算能力。
The multiply-accumulate unit (MAC) specified in this paper describes a novel architecture. It can handle operation of 16-bit and 32-bit separately or mixed operation of them in different modes.
在乘法和除法运算中，用作累加器扩充的一种寄存器。
A register used as an extension of the accumulator during multiply and divide processes.
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