锁相环用新型全差分CMOS电荷泵设计 - 中国优秀硕士学位论文全文数据库 出了更高的要求。高频率、低电压、低功耗、低噪声、高稳定性锁相环的需求量越来越大。在各种锁相环结构中,电荷泵锁相环(CPPLL,Charge-Pump Phase-Locked Loop)以其锁定相差小和捕获范围大的优点成为当前锁相环产品的主流。本文首先论述了锁相环基本原理和结构,叙述了
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... solid-liquid two phase pump 固 Charge Pump Phase Locking Loop 电荷泵锁相环 Charge Pump Phase Locked Loop 结构中 ; 型混合电路电荷泵锁相环 ...
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mixed circuits 在 无线电电子学 分类中 的翻译结果 --cnki翻译助手 Description Language)和混合电路行为级设计方法的基础上,实现了一个典型混合电路—电荷泵锁相环(CPPLL, Charge Pump Phase Locked Loop)的行为级模型。 短句来源 Some important methods of mixed
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Having summarized top-down design flow of modern integrated circuit,this paper gives the design of the system parameters of charge pump phase locked loop(PLL) frequency synthesizer from the perspective of system.
在归纳总结现代集成电路Top-Down的设计流程的基础上,从系统的角度出发,提出电荷泵锁相环频率合成器系统参数的设计方法。
参考来源 - CMOS锁相环频率合成器系统设计·2,447,543篇论文数据，部分数据来源于NoteExpress
In this dissertation, theory, model, design and implementation of charge pump phase locked loop frequency synthesizer are lucubrated.
本文围绕电荷泵频率合成器的理论、模型、设计和实现，进行了深入的研究。
A novel multi-layer Charge-Pump Phase-Locked Loop (CP-PLL) behavioral model is presented in this paper.
提出了一种全新的电荷泵锁相环的行为级建模方法。
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