HDA链路采用了锁定于HDA控制器提供的24MHz位时钟(BCLK)的控制器同步比特流，所有音频输入和输出数据流都与一个帧速率固定为48kHz的SYNC信号同步。
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CPU外频（Bclk）：i7时代CPU工作频率也是CPU外频*CPU倍频，与Conroe一样锁定了倍频的CPU也只好提升外
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PCM音频接口，是在微处理器或DSP与音频器件间用于数字转换的接口，它由时钟脉冲（BCLK）、帧同步信号（FS）及接受数据（DR）和发送数据（DX）组成。
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例如，若EISA总线时钟为8.33 MHz, 当它进行8位存储器存取时，一个存储器存取周期最快为3个 BCLK(总线时钟)， 则其总线传输率为2.78 MB/s。
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