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SCLK

网络释义

  串行时钟

串行输出(MISO):ISD的串行输出端。ISD未选中时,本端呈高阻态。串行时钟SCLK):ISD的时钟输入端,由主控制器产生,用于同步MOSI和MISO的数据传输。数据在SCLK上升沿锁存到ISD,在下降沿移出ISD。

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  时钟线

SPI总线有4根信号线,分别是从机选择线( SS) 、时钟线( SCLK) 、主机输出从机输入线( MOSI) 、主机输入从机输出线( MISO) :· SS:用于选择激活某个从机,由主机驱动输出。

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  频率合成器时钟

... LO-OUT 本振信号输出 SCLK 频率合成器时钟 SDATA 频率合成器数据 ...

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  串行时钟输入

串行时钟输入SCLK) : 数据在时钟上升沿移入,在下降沿移出。

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短语

SCLK SimplifiedCLocK 简化的时钟

SCLK I 串行时钟

SCLK Multimedia Card 多媒体卡串行时钟

VCC GND CS SDA SCLK 五线制

UP-SCLK Up Serial Clock 上串行时钟

WIRE-SCLK Wire Serial Clock 串行总线时钟

SCLK Simplified CLocK 简化的时钟

sclk-simplifiedclock- 简化的时钟

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- 来自原声例句
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