一种减少集成电路时钟偏离(clock skew)的方法及装置，该集成电路具有数个电路区块(circuit block)，该方法包括下列步骤：提供第一时钟讯号源耦接至这些电路区块中的第一电路区块的时钟讯号输入端，且提供第二时钟讯号源耦接至这...
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电路区块
Circuit block
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