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更多释义

• 1.DDS-driven PLL frequency synthesizer architecture is given in this paper.
  给出了一种基于DDS驱动PLL的频率综合器结构。
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• 2.A new phase noise estimate method for millimeter wave double PLL frequency synthesizer is presented.
  提出了一种新的毫米波双环锁相源相位噪声估测方法。
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• 3.A passive loop filter scheme and the design method of the filter for current charge pump PLL frequency synthesizer chip are given in the paper.
  针对电流型电荷泵PLL频率综合器芯片，提出一种称为极值相位裕量的无源环路滤波器方案和设计方法。
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