高阻状态是三态门电路的一种状态。逻辑门的输出除有高、低电平两种状态外，还有第三种状态——高阻状态的门电路。
在省电模式下，数字输出被置为高阻状态。
In power-down mode, the digital outputs are driven to a high impedance state.
第二组处于收缩期正常流速，舒张末期低流速，肾血管高阻状态。
In the second phase group it was in a state of normal systolic flow velocity, low diastolic flow velocity and high renal vascular resistance.
在这种切换中，读出的数据有效前，数据总线至少需要有一个时钟的高阻状态。
The data bus must go into a high-impedance state at least one cycle before output of the latest data.
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