使FPGA的Spartan - IIE的家人经常化，灵活，可配置逻辑块（CLB），由环绕四周的可编程输入，可编程架构/输出模块（IOBs）。有四种延迟锁定环（DLL），在每一个角落的死。
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1) 输出块(IOBs)：供应封装腿与CLB 之间的接口它支撑多种IO 接口旌旗灯号规范； 2) 装备逻辑块(CLBs)：供应结构逻辑的功用元件；
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本文设计的数据采集与处理平台的各 户设计的逻辑功能；输入输出块（IOBs），lOBs提供封装引脚和 主要功能均在FPGA内部实现，主要包括系统全局时钟模块。
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} 输入与输出（IOBs） } FPGA与外围电路的接口
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