...正的电路设计 软核是包括逻辑描述(RTL 和门级VHDL 或 Veril og HDL 代码) 网表和不能物理实现的用于 测试的文档(test bench file) 与硬核相比较软核有 最大的灵活性 用户能把RTL 和门级HDL 表达的 软核修改为自己所需要的设计 综合到选定的厂 商工艺上 并通过布...
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test bench file
试验台文件
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