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master serial mode

网络释义

  式采用主串方式

配置模式采用主串方式(Master Serial Mode),这种配置模式有利于简化PCB 的设计,并且主串模式的配置时钟源于FPGA内部,不需要外部另外再提供。

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  串行模式

FPGA的加载模式为主控串行模式(Master Serial Mode),FPGA功能框图如图3所示。FPGA设计包括加速度计信号计数器设计、陀螺信号计数器设计、里程计信号计数器设计、陀螺合频计数器设计...

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  主串模式

...序 Xilinx公司的Spartan系列FPGA的配置方式主 在Programe引脚上产生1个超过2斗s的低脉 要有四种:主串模式Master serial mode)、从串模式 冲,等待INIT回应1个低脉冲以及DONE引脚变 作者简介:钟棋(1976一),男,湖南人,博士研究生,主研方向:交流电机调...

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短语

serial master mode 串行主模式

有道翻译

master serial mode

主串行模式

以上为机器翻译结果,长、整句建议使用 人工翻译

双语例句

  • The serial interface operates in internal clocking (master) mode, the AD7721 providing the serial clock.

    串行接口内部时钟()模式下工作,AD 7721提供所需的串行时钟

    youdao

更多双语例句
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- 来自原声例句
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